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• 000 01113nam0 2200253 450

• 001 0001472754

• 005 20241212101600.0

• 010 __ |a 978-7-121-44867-6 |d CNY69.00

• 100 __ |a 20230222d2023 em y0chiy50 ea

• 101 0_ |a chi

• 102 __ |a CN |b 110000

• 105 __ |a a z 000yy

• 106 __ |a r

• 200 1_ |a Verilog HDL实用教程 |A verilog hdl shi yong jiao cheng |b 专著 |f 王金明，徐程骥编著

• 210 __ |a 北京 |c 电子工业出版社 |d 2023

• 215 __ |a 11,296页 |c 图，照片 |d 26cm

• 300 __ |a 普通高等教育EDA技术教材

• 330 __ |a 本书讲解Verilog HDL语言规则、语法体系，以Verilog-2001和Verilog-2005两种语言标准为依据，主要内容包括Verilog HDL入门、数据类型、表达式、门级和开关级建模、数据流建模、行为级建模、层次结构、任务与函数、Test Bench测试与时序检查、面向综合的设计、有限状态机设计、Verilog HDL设计实例等，重点聚焦Verilog HDL综合和仿真，对语言、语法规则用案例进行阐释，用综合工具和仿真工具进行验证。

• 606 0_ |a VHDL语言 |x 程序设计 |x 高等学校 |j 教材

• 690 __ |a TP312VH |v 5

• 701 _0 |a 王金明 |A wang jin ming |4 编著

• 701 _0 |a 徐程骥 |A xu cheng ji |4 编著

• 801 _0 |a CN |b 鄞州新华 |c 20230222

• 905 __ |a ZPHC |d TP312VH/6